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BIBLIOGRAPHY AND READINGS ON CPU CACHE MEMORIES AND RELATED TOPICS*.

S.L. : s.n., 1986

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Etude de Quelques Organisations D'Antememoires

Drach, Nathalie ; Seznec, André (1959-....)

s.l. : s.n., 1992

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LINE (BLOCK) SIZE CHOICE FOR CPU CACHE MEMORIES.

New York : IEEE, 1987

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MEmory performance. MEDEA'05 : DEaling with applications, systems and architecture. MEDEA-2005 Workshop

New York : ACM, 2006

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Dasc cache : Dealing with cache access time and virtual indexing

Seznec, André ; IRISA 117

S.l., 1993

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SKEWED-ASSOCIATIVE CACHES.

ROCQUENCOURT : INRIA, 1992

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Skewed associativity enhances performance predictability

Bodin, François ; Seznec, André ; IRISA 117

S.l., 1995

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A tile selection algorithm for data locality and cache interference

New York : ACM, 1999

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Two complementary notes on skewed-associative caches

Seznec, André ; IRISA 117

S.l., 1992

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PARADIGM : A HIGHLY SCALABLE SHARED-MEMORY MULTICOMPUTER ARCHITECTURE

New York : IEEE, 1991

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LIFE SPAN STRATEGY-A COMPILER-BASED APPROACH TO CACHE COHERENCE.

S.L. : s.n., 1992

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THE STANFORD DASH MULTIPROCESSOR.

New York : IEEE, 1992

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MULTIPROCESSOR CACHE DESIGN CONSIDERATIONS.

S.L. : s.n., 1988

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An Effective write policy for software coherence schemes

S.L. : s.n., 1992

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COMPILER-DIRECTED CACHE MANAGEMENT FOR MULTIPROCESSORS.

S.L. : s.n., 1990

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An analytical cache model = Etude d'un modèle analytique de mémoire cache : architectures parallèles, bases de données, réseaux et systèmes distribués

Rocquencourt : INRIA, 1991

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A BIBLIOGRAPHY FOR MULTIPROCESSOR CACHE MEMORIES.

New York : ACM, 1991

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STRATEGY (A) FOR ARRAY MANAGEMENT IN LOCAL MEMORY.

ROCQUENCOURT : INRIA, 1990

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COMPARISON OF HARDWARE AND SOFTWARE CACHE COHERENCE SCHEMES.

Adve, Sarita V. ; Adve, V.S. ; Hill, Mark D. ; Vernon, M.K.

s.l. : s.n., 1991

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CACHE (A) COHERENCE MECHANISM FOR SCALABLE,SHARED-MEMORY MULTIPROCESSORS.

S.L. : s.n., 1991

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